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90nm CMOS में एक पावर-कार्यक्षम 6.25Gb/s ट्रांससीवर चिप-टू-चिप संचार के लिए प्रस्तुत किया गया है, यह 3.125GHz पर -15dB कमी वाले चैनल पर -15 के BER पर संचालित होते हुए 2.2mW/Gb/s ऊर्जा खर्च करता है। पावर कम करने के लिए एक साझा LC-PLL, प्रत्यावर्ती क्लॉक वितरण, एक कम-स्विंग वोल्टेज-मोड ट्रांसमीटर, एक कम-शक्ति फेज़ रोटेटर, और सॉफ़्टवेयर-आधारित CDR तथा अनुकूली इक्वलाइज़र का उपयोग किया गया है।
Palmer et al. (Thu,) ने इस प्रश्न का अध्ययन किया।
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