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Die architektonische Simulation ist zeitaufwendig, und der Trend zu Hunderten von Kernen macht die sequenzielle Simulation noch langsamer. Bestehende parallele Simulationstechniken skalieren entweder schlecht aufgrund übermäßiger Synchronisation oder opfern die Genauigkeit, indem sie eine Ereignisneuordnung zulassen und vereinfachte Konfliktmodelle verwenden. Infolgedessen verwenden die meisten Forscher sequentielle Simulatoren und modellieren Systeme im Kleinmaßstab mit 16-32 Kernen. Da Chips mit 100 Kernen bereits verfügbar sind, ist es entscheidend, Simulatoren zu entwickeln, die auf Tausende von Kernen skalieren.
Sánchez et al. (Sun,) untersuchten diese Frage.