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이 논문은 노이즈 면역성을 높이기 위해 전류 통합을 활용하는 고속 수신기 설계를 제시합니다. 들어오는 신호 전압에 기반한 커패시터의 전류 통합은 들어오는 신호를 유효 시간 동안 효과적으로 평균화하여 고주파 노이즈를 필터링합니다. 이 개념을 설명하는 실험 설계가 1.2μm CMOS 기술로 제작되었습니다. 수신기는 5V 전원에서 작동하며 2.7mW의 전력을 소모하고, 250MHz의 클럭 주파수에서 무결점 작동을 달성하며, 실리콘 면적의 60×450μm²를 차지합니다.
Sidiropoulos et al. (화요일,) 이 질문을 연구했습니다.
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